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[主观题]

设有八体并行低位交叉存储器,每个模块的存储容量是64K×32位,存取周期是500 ns,则在500 ns内,该存

储器可向CPU提供________位二进制信息,比单个模块存储器的速度提高了________倍。

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第1题
设有8个模块组成的八体存储器结构,每个模块的存取周期为400 ns,存储字长为32位。数据总线宽度为32
位,总线传输周期50 ns,试求顺序存储(高位交叉)和交叉存储(低位交叉)的存储器带宽。

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第2题
交叉存储器实际上是一种()的存储器,它能()执行多个独立的读/写操作。A.模块式、并行B.整

交叉存储器实际上是一种()的存储器,它能()执行多个独立的读/写操作。

A.模块式、并行

B.整体式、并行

C.模块式、串行

D.整体式、并行

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第3题
交叉存储器实质上是一种()存储器,它能()执行()独立的读写操作。A.模块式,并行,多个B.模

交叉存储器实质上是一种()存储器,它能()执行()独立的读写操作。

A.模块式,并行,多个

B.模块式,串行,多个

C.整体式,并行,一个

D.整体式,串行,多个

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第4题
交叉存储器实质上是一种______存储器,它能______执行______独立的读写操作。

A.模块式,并行,多个

B.模块式,串行,多个

C.整体式,并行,一个

D.整体式,串行,多个

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第5题
某计算机的主存采用体宽为8B的8体交叉存储器,数据总线的宽度为64位,读一个主存块的步骤: (1

某计算机的主存采用体宽为8B的8体交叉存储器,数据总线的宽度为64位,读一个主存块的步骤: (1)发送首地址到主存(一个总线时钟周期); (2)主存控制器接受到地址后,启动第一个模块准备数据,并每隔一个总线时钟启动下一个模块准备数据。每个存储模块花4个总线时钟准备好64位数据,总线上传输一个64位数据花一个总线时钟。请问: 该计算机的Cache缺失损失(从主存中读一个主存块到Cache的时间)至少为多少总线时钟周期?

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第6题
定量分析n体低位交叉存储器连续读取n个字所需的时间。

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第7题
采用四体并行低位交叉存储器,设每个体的存储容量为32K×16位,存取周期为400 ns,在下述说法中_____
___是正确的。

A.在0.1 μs内,存储器可向CPU提供26位二进制信息

B.在0.1 μs内,每个体可向CPU提供16位二进制信息

C.在0.4 μs内,存储器可向CPU提供26位二进制信息

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第8题
某机器采用四体低位交叉存储器,现分别执行下述操作:①读取6个连续地址单元中存放的存储字,重复80
次;②读取8个连续地址单元中存放的存储字,重复60次。则①、②所花费的时间之比为()。

A.1:1

B.2:1

C.4:3

D.3:4

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第9题
设有两个4字节十六进制数,分别放在内RAM 40H和50H起始的单元中,求这两数之和,并将和存放到40H为起始的单元
中(均低位先存)。另有两个6字节的16进制数,分别存放在内RAM 60H和70H起始的单元中,求两数之和,并将和存放在60H为起始的单元中。
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第10题
已知单个存储体的存储周期为110ns,总线传输周期为10ns,则当采用低位交叉编址的多模块存储器时,存
储体数应()。

A.小于11

B.等于11

C.大于11

D.大于等于11

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