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用VHDL描述下列器件的功能： (1)4选1数据选择器； (2)2线-4线译码器； (3)时钟R-S触发器； (4)带复位端Clear和置位端Preset、延迟Tpd为20ns的响应CP下降沿的J-K触发器； (5)主从J-K触发器； (6)集成计数器74163； (7)集成移位寄存器74194。
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A.器件外部特性
B.器件的内部功能
C.器件的综合约束
D.器件外部特性与内部功能
A.提供用VHDL等硬件描述语言描述的功能块，但不涉及实现该功能块的具体电路
B.提供设计的最总产品一模型库
C.以可执行文件的形式提交用户，完成了综合的功能块
D.都不是
A.c1ock' EVENT
B.c1ock' EVENT AND c1ock=' 1'
C.c1ock=' 0'
D.c1ock' EVENT AND clock=' 0'
A .软IP
B.固IP
C.硬IP
D.都不是
用其他指令完成和下列指令一样的功能： (1)REP MOVSB (2)REP LODSB (3)REP STOSB (4)REP SCASB
A.PLC是一种数字式的电子装置
B.PLC具有可靠性高，改变控制功能容易的显著优点
C.是一种以微处理器为核心器件的逻辑和顺序控制装置
D.PLC的编程方法复杂
A.（1）（3）
B.（2）（4）
C.（2）（3）
D.（2）（3）（4）
拟定101序列检测器的状态图。 (1)101序列可以重叠，如输入序列010101101，输出序列000101001。 (2)101序列不可以重叠，如输入序列010101101，输出序列000100001。 (3)用VHDL语言设计这个系列检测器。
