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[主观题]

内部总线是指CPU内部连接各逻辑部件的一组数据传输线,它用三态门和多路开关来实现。()

内部总线是指CPU内部连接各逻辑部件的一组数据传输线,它用三态门和多路开关来实现。( )

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第1题
串行总线主要用于( )。

A.连接主机与外围设备

B.连接主存与CPU

C.连接运算器与控制器

D.连接CPU内部各部件

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第2题
单处理器系统中的总线可以分为三类:CPU内部连接各寄存器及运算部件之间的总线称为______;中、低速I/O设备之
间相互连接的总线称为______;同一台计算机系统内的高速功能部件之间相互连接的总线称为______。
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第3题
下列不是用于连接CPU和计算机内部其他高速功能部件的总线是()。

A.内部总线

B.数据总线

C.地址总线

D.控制总线

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第4题
系统级的总线是用来连接( )。

A.CPU内部的运算器和寄存器

B.主机系统板上的所有部件

C.主机系统板上的各个芯片

D.系统中的各个功能模块或设备

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第5题
关于接口的说法,错误的是()。

A.计算机中只能有一种接口类型

B.接口指CPU和主存、外围设备之间通过总线进行连接的逻辑部件

C.接口部件在它动态连接的两个部件之间起着“转换器”的作用,以便实现彼此之间的信息传送

D.不同的接口有不同的作用

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第6题
某机器的寻址空间为64K,数据总线为8位。现有8K×8位SRAM芯片,SRAM有CS和WE控制信号;4K×8位DRAM芯片
,DRAM有CS、wE等控制信号,数据总线是双向。CPU有MERQ、R/W等控制信号(表示低电平有效)。 (1)写出DRAM控制器内部的逻辑部件名称; (2)从0000H开始安排32K×8位SRAM,从A000H安排8K×8位DRAM,画出CPU的DRAM存储器连接电路图(包括74LS138等组成的片选电路、DRAM控制器,DRAM控制器仅要求画出输入、输出信号); (3)设DRAM读/写周期为0.5μs,CPU在1μs内要访问内存1次或2次,平均1μs访存约1.2次,刷新周期为2ms。有哪几种刷新方式,采用哪种刷新方式比较合理,并说明采用的刷新方式的时间参数和理由。

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第7题
下面关于CPU结构的叙述中,有错误的是()

A.内部总线是CPU中各部件之间的数据传输通道

B.时序部件用于产生CPU中各部件协调工作所需要的时序信号

C.PU令在执行过程中还可以分解成一系列不可再分的微操作命令信号

D.指令译码器可以识别指令的功能,并对指令加以执行

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第8题
下列哪一项不是CPU的组成部件()

A.控制器

B.运算器

C.ache

D.内部总线

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第9题
总线是连接计算机内部多个功能部件的一组公共信息通路。()
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第10题
CPU中,除了内部总线和必要的寄存器外,主要的两大部件分别是运算器和()

A.控制器

B.存储器

C.ache

D.编辑器

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