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[主观题]

试画出实现1位余3BCD码加法运算加法器（如图1—1所示)的逻辑框图。

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第1题

有一个十进制数加法运算系统,它利用4位二进制数加法器对一位8421BCD码进行加法运算.其操作过程如下:先将两个1位十进制数存入寄存器A和B,然后进行相加.如果和数等于或小于9,则运算结果正确;如果和数大于10,还需要对运算结果进行加6(0110)修正,这是因为用二进制数表示十进制数时,多余了6种状态.(1)请设计系统方框图;(2)请设计ASM流程图.

有一个十进制数加法运算系统,它利用4位二进制数加法器对一位8421BCD码进行加法运算.其操作过程如下:先将两个1位十进制数存入寄存器A和B,然后进行相加.如果和数等于或小于9,则运算结果正确;如果和数大于10,还需要对运算结果进行加6（0110)修正,这是因为用二进制数表示十进制数时,多余了6种状态.（1)请设计系统方框图;（2)请设计ASM流程图.

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第2题

试用4位加法器74HC283实现8位二进制运算。要求当K=0时，完成加法运算；K=1时，完成减法运算。

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第3题

在三个过程段的浮点加法运算流水线中，假设每个过程段所需的时间分别是60 ns、90 ns、70 ns，试求三

级流水线加法器的加速比。

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第4题

试用JK触发器设计一个2位同步二进制多功能计数器。当控制端XY=00时，计数器状态不变；XY=01时，为加

法计数；XY=10时，为减法计数；XY=11时，则次态为现态求反运算。试写出该计数电路的控制输入真值表(包括状态转换激励表)，并画出用与非门和JK触发器实现这一控制的逻辑电路图。

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第5题

X、Y为定点整数，其格式为1位符号位，n位数值位，若采用补码一位乘法实现乘法运算，则最多需要（）

次加法运算。

A．n-1

B．n

C．n+1

D．n+2

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第6题

转换：①（11011101)2；②（763)10；③（312)8；④（FF)16；⑤（10010011)8421BCD；⑥（11000011)余3BCD成8421BCD码

转换：①(11011101)2；②(763)10；③(312)8；④(FF)16；⑤(10010011)8421BCD；⑥(11000011)余3BCD成8421BCD码。

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第7题

与4位串行进位加法器比较,使用超前进位全加器的目的是（)

A.完成自动加法进位

B.完成4位加法

C.完成4位串行加法

D.提高运算速度

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第8题

加法器是电动单元组合仪表中的一种运算器，它对4路输入信号只能进行加法运算，并給出标准模拟输出信号或者状态输出信号。（)

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第9题

用下列代码表示数（468．32)10 （1)8421BCD码（2)2421BCD码（3)5421BCD码（4)余3BCD码

用下列代码表示数(468．32)10 (1)8421BCD码 (2)2421BCD码 (3)5421BCD码 (4)余3BCD码

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第10题

完成下列各数的转换。（1)（73．26)10=（)8421码（2)（31．67)10=（)余3BCD码（3)（465)10=（)2421B

完成下列各数的转换。 (1)(73．26)10=()8421码 (2)(31．67)10=()余3BCD码 (3)(465)10=()2421BCD码 (4)(1101 1010 0011)631-1BCD码=()10 (5)(1000 0101 1001 0111)8421BCD码=()10

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