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[主观题]

图6-26所示ADC中,已知4位DAC输出满量程电压Vomax=1 5V,触发器现态为0,计数器响应下降沿,输入电压

图6-26所示ADC中,已知4位DAC输出满量程电压Vomax=1 5V,触发器现态为0,计数器响应下降沿,输入电压V1=10V,试求: (1)画出N,A,B各点波形; (2)求Vi对应Vi=10V时,输出数字量D3D2D1D0是多少?

图6-26所示ADC中,已知4位DAC输出满量程电压Vomax=1 5V,触发器现态为0,计数器响应

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第1题
图6-33所示是一个简易的电压采集和反馈控制系统,其中ADC为ICL7135DAC为DAC1210(12位MDAC)。在不考

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图6-33所示是一个简易的电压采集和反馈控制系统,其中ADC为ICL7135DAC为DAC1210(DAC为DAC1210(12位MDAC)。在不考虑数据处理的情况下,试设计控制ADC采集输入数据,并直接由DAC输出反馈控制电压Vo的控制器流程,给出时序图和电路图。

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第2题
在图10.1.2所示的倒T形电阻网络DAC中,设VREF=5 V,RF=R=10 kgl,求对应于输入4位二进制数码为0101,
0110,1101时的输出电压。

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第3题
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图6-17所示DAC的满量程输出电压为±5V,若输入数字量D=10110,分别指出下述两种代码输入时,相应的输出模拟电压Vo值: (1)D为偏移二进制码; (2)D为2的补码。

图6-17所示DAC的满量程输出电压为±5V,若输入数字量D=10110,分别指出下述两种代码输入时

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第4题
在图10.6.1所示的DAC中,已知输入为8位二进制数码,接在CB7520的高8位输入端上,VREF=10 V。为保证VR
EF偏离标准值所引起的误差

在图10.6.1所示的DAC中,已知输入为8位二进制数码,接在CB7520的高8位输入端上,VREFLSB(现在的LSB应为d2),允许VREF的最大变化△VREF是多少?VREF的相对稳定度

在图10.6.1所示的DAC中,已知输入为8位二进制数码,接在CB7520的高8位输入端上,VREF应为多少?

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第5题
已知AD7520是10位集成倒T型电阻网络DAC,其结构如图10.3.2所示。如果不加VB和RB,则vO输出单极性电
压;若加了VB和RB,就可在数字量从0到满量程输入时,输出双极性电压。试分析其工作原理。若取RB=20 kΩ,为了得到±5 V的最大输出模拟电压,VREF和VB应取何值?

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第6题
在图LT4-23所示两级共发放大器的交流通路中,已知试估算该电路的土限频率fH.(忽略第二级输
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在图LT4-23所示两级共发放大器的交流通路中,已知在图LT4-23所示两级共发放大器的交流通路中,已知试估算该电路的土限频率fH.(忽略第二级输在图L在图LT4-23所示两级共发放大器的交流通路中,已知试估算该电路的土限频率fH.(忽略第二级输在图L在图LT4-23所示两级共发放大器的交流通路中,已知试估算该电路的土限频率fH.(忽略第二级输在图L在图LT4-23所示两级共发放大器的交流通路中,已知试估算该电路的土限频率fH.(忽略第二级输在图L试估算该电路的土限频率fH.(忽略第二级输入电容对第一级的影响.)

在图LT4-23所示两级共发放大器的交流通路中,已知试估算该电路的土限频率fH.(忽略第二级输在图L

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第7题
在图10.3.2所示的R-2R倒T型电阻网络DAC中,取掉RB和VB,外接参考电压VREF=-10 V。为保证VREF偏离标

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在图10.3.2所示的R-2R倒T型电阻网络DAC中,取掉RB和VB,外接参考电压VREF=-10 LSB,试计算相对稳定度应取多少?

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第8题
在图10.1.1所示的权电阻网络DAC中,设R=10 kΩ,RF=5 kΩ。试求其他权电阻的阻值。若VREF=5 V,输入的二
进制数码D3D2D1D0=1101,求输出电压vO。

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第9题
在图10.3.5所示并行的比较型ADC中,VREF=7 V,试问电路的最小量化单位△等于多少?当vI=2.4 V时输出
数字量D2D10D0为多少?此时的量化误差多大?

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第10题
数模转换器的英文缩写是()。

A.ADC

B.DAC

C.DSP

D.CPU

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