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[主观题]

设CPU内有下列部件:PC、IR、SP、AC、MAR、MDR和CU,要求: (1)写出完成间接寻址的取数指令LDA@X(将

设CPU内有下列部件:PC、IR、SP、AC、MAR、MDR和CU,要求: (1)写出完成间接寻址的取数指令LDA@X(将主存某单元的内容取至AC中)的信息流。 (2)画出中断周期的信息流,并简要说明。

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第1题
模型机数据通路结构由CPU内总线、逻辑运算部件ALU、输入选择器A和B、输出移位器、通用寄存器R0~R3、暂
存器C和D、地址寄存器MAR、数据缓冲寄存器MDR、指令寄存器IR、程序计数器PC、堆栈指针SP组成。(电子科大2006) (1)模型机传送指令MOV(R0),(SP)+;其源采用自增型寄存器间址,目的采用寄存器 间址。用寄存器传送语句(如PC→MAR)拟出该指令的流程。 (2)转移指令JMP X(PC);转移地址采用相对寻址,位移量存放在现行指令所在单元的下一个单元中,以位移量地址为基准进行转移。该指令的流程如下。读懂该流程,并为每题选择一个正确答案。 取指周期FT:M→IR IR的内容为______________ PC+1→PC PC的内容为______________ 执行周期ET:PC→MAR MAR的内容为______________ M→MDR→C C的内容为______________ PC+C→PC MAR的内容为______________ ①现行指令 ②下条指令 ③源操作效 ④位移量 ⑤源地址 ⑥位移量地址 ⑦现行指令地址 ⑧转移地址

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第2题
设CPU内的部件有:PC、IR、MAR、MDR、ACC、ALU、CU,且采用非总线结构。 (1)写出取指周期的全部微操

设CPU内的部件有:PC、IR、MAR、MDR、ACC、ALU、CU,且采用非总线结构。 (1)写出取指周期的全部微操作。 (2)写出取数指令LDA X,存数指令STA X,加法指令ADD X(X均为主存地址)在执行阶段所需的全部微操作。 (3)当上述指令均为间接寻址时,写出执行这些指令所需的全部微操作。 (4)写出无条件转移指令JMP Y和结果为零则转指令BAZ Y在执行阶段所需的全部微操作。

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第3题
CPU执行算术运算或逻辑运算时,算术逻辑运算部件(ALU)将计算结果保存在()中。

A.累加器AC

B.程序计数器PC

C.指令寄存器IR

D.地址寄存器AR

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第4题
在CPU的寄存器中,PC表示______寄存器;SP表示______寄存器。
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第5题
CPU结构如图所示,其中有一个累加寄存器AC、一个状态条件寄存器和其他四个寄存器,各部分之间的连线表示数据通路,箭头表示信息传送方向。图中abcd四个寄存器的名称分别为()。

CPU结构如图所示,其中有一个累加寄存器AC、一个状态条件寄存器和其他四个寄存器,各部分之间的连线表

A、DR、AR、PC、IR

B、DR、PC、IR、AR

C、DR、IR、AR、PC

D、AR、IR、DR、PC

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第6题
解释英文缩写的含义:CPU、PC、IR、CU、ALU、ACC、MQ、X、MAR、MDR、I/O。

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第7题
硬连线控制器是由以下部件组成()。
硬连线控制器是由以下部件组成()。

B.程序计数器PC、指令寄存器IR、控制信号产生部件

B.程序计数器PC、指令寄存器IR、控制信号产生部件,节拍发生器

C.程计数器PC、指令寄存器IR、控制信号产生部件,步骤标记

D.指令寄存器IR、控制信号产生部件,节拍发生器

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第8题
● 下图为 CPU 结构,其中有一个累加寄存器 AC,一个状态寄存器和其他四个寄存器,各个部分之间的连
线表示数据通路,箭头表示信息传送方向,其中 a,b,c,d 四个寄存器依次是 (31) 。

● 下图为 CPU 结构,其中有一个累加寄存器 AC,一个状态寄存器和其他四个寄存器,各个部分之间的

(31)

A. DR,IR,AR,PC

B. IR,AR,PC,DR

C. AR,PC,DR,IR

D. PC,DR,IR,AR

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第9题
指出主机中ACC、IR、MDR、PC等寄存器或部件的位数。

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第10题
在控制器中,部件()用于存放下一条指令的地址。

A.指令指针IP

B. 地址寄存器AR

C. 指令寄存器IR

D. 程序计数器PC

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