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[主观题]

设某机有四个中断源1、2、3、4,其硬件排队优先次序按1→2→3→4降序排列,各中断源的服务程序中所对应的

屏蔽字如表8.6所示。

设某机有四个中断源1、2、3、4,其硬件排队优先次序按1→2→3→4降序排列,各中断源的服务程序中所(1)给出上述四个中断源的中断处理次序。 (2)若四个中断源同时有中断请求,画出CPU执行程序的轨迹。

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第1题
设某机有四个中断源A、B、C、D,其硬件排队优先次序为A>B>C>D,现要求将中断处理次序改为D>A>C>B。
(1)写出每个中断源对应的屏蔽字。 (2)按图8.22时间轴给出的四个中断源的请求时刻,画出CPU执行程序的轨迹。设每个中断源的中断服务程序时间均为20 μs。

设某机有四个中断源A、B、C、D,其硬件排队优先次序为A>B>C>D,现要求将中断处理次序改为D>A

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第2题
某机有四个中断源,优先顺序按1→2→3→4降序排列,若想将中断处理次序改为3→1→4→2,则1、2、3、4中断源对
应的屏蔽字分别是________、________、________和________。

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第3题
设某机有六个中断源,优先顺序按0→1→2→3→4→5降序排列。 (1)若在某用户程序的运行过程中,依次

设某机有六个中断源,优先顺序按0→1→2→3→4→5降序排列。 (1)若在某用户程序的运行过程中,依次发生了3、2、1级中断请求,画出CPU的程序运行轨迹。 (2)若在3、2、1级中断请求发生之前,用改变屏蔽字的方法,将优先级的顺序从高到低改为0→5→3→4→1→2。试在与(1)相同的请求顺序和请求时间的情况下,画出CPU程序的运行轨迹。

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第4题
某机有三个中断源,其优先级按1→2→3降序排列。假设中断处理时间均为τ,在图8.29所示的时间内共发生
五次中断请求,图中①表示1级中断源发出中断请求信号,其余类推,画出CPU执行程序的轨迹。

某机有三个中断源,其优先级按1→2→3降序排列。假设中断处理时间均为τ,在图8.29所示的时间内共发

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第5题
有4个中断源D1、D2、D3和D4,它们的中断优先级从高到低分别是1级、2级、3级和4级。即中断响应先后次序为1→2→3→4,

有4个中断源D1、D2、D3和D4,它们的中断优先级从高到低分别是1级、2级、3级和4级。即中断响应先后次序为1→2→3→4,现要求其实际的中断处理次序为4→3→2→1。

(1)写出这些中断源的正常中断屏蔽码和改变后的中断屏蔽码(令“0”对应于开放,“1”对应于屏蔽)。

(2)若在运行用户程序时,同时出现第1、2、3、4级中断请求,请画出此程序运行过程示意图。

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第6题
某机有四级中断,优先级从高到低为1→2→3→4。若将优先级顺序修改,改后1级中断的屏蔽字为1011,2级中
断的屏蔽字为1111,3级中断的屏蔽字为0011,4级中断的屏蔽字为0001,则修改后的优先顺序从高到低为________。

A.3→2→1→4

B.1→3→4→2

C.2→1→3→4

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第7题
某机有五级中断,优先级从高到低为1→2→3→4→5。若将优先级顺序修改,改后1级中断的屏蔽字为1111,2级
中断的屏蔽字为01010,3级中断的屏蔽字为01111,4级中断的屏蔽字为00001,5级中断的屏蔽字01011,则修改后的处理优先级顺序从高到低为____________。

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第8题
设某机共能完成120种操作,CPU有8个通用寄存器(12位),主存容量为16K字,采用寄存器—存储器型指令。

设某机共能完成120种操作,CPU有8个通用寄存器(12位),主存容量为16K字,采用寄存器—存储器型指令。 (1)欲使指令可直接访问主存的任一地址,指令字长应取多少位? (2)若在上述设计的指令字中设置一寻址特征位X,且X=0表示某个寄存器作基址寄存器,画出指令格式。试问采用基址寻址可否访问主存的任一单元?为什么?如不能,提出一种方案,使指令可访问主存的任一位置。 (3)若指令字长等于存储字长,且主存容量扩大到64K字,在不改变硬件结构的前提下,可采用什么方法使指令可访问存储器的任一位置?

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第9题
某机使用的指令格式和寻址方式如图7.17所示,该机有16个16位的通用寄存器,并可选定任一个通用寄存
器作为变址寄存器。指令汇编格式中的S(源)、D(目标)都是通用寄存器,M是主存中的一个单元。

某机使用的指令格式和寻址方式如图7.17所示,该机有16个16位的通用寄存器,并可选定任一个通用寄存试问: (1)CPU完成哪一种操作花的时间最短?为什么? (2)CPU完成哪一种操作花的时间最长?为什么? (3)第②种指令的执行时间有时会等于第③种指令的执行时间吗?为什么? (4)哪一种指令操作数的寻址范围最大?为什么?

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第10题
在一个8级中断系统中,硬件中断响应应从高到低优先顺序是: 1→2→3→4→5→6→7→8 设置中断屏
蔽寄存器后,中断响应的优先顺序变为: 1→3→5→7→2→4→6→8 如果CPU在执行一个应用程序时有5、6、7、8级4个中断同时到达,CPU在按优先顺序处理到第3个中断请求的过程中又有一个3中断请求到达CPU,试画出CPU响应这些中断的顺序示意图。

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