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第4题
假设X、Y、Z寄存器均为16位（最高位为第0位)。在乘法开始前，被乘数已存于X中，并用Y／／Z存放乘积。
假设X、Y、Z寄存器均为16位(最高位为第0位)。在乘法开始前，被乘数已存于X中，并用Y／／Z存放乘积。 (1)画出实现补码Booth算法的运算器框图。 (2)假设CU为组合逻辑控制，且采用中央控制和局部控制相结合的办法，写出完成MUL α指令(α为主存地址)的全部微操作命令及节拍安排(包括取指阶段)。 (3)指出哪些节拍属于中央控制节拍，哪些节拍属于局部控制节拍，局部控制最多需几拍？
第6题
画出实现补码加减交替除法的运算器框图，要求： （1)指出寄存器和全加器位数； （2)详细画
画出实现补码加减交替除法的运算器框图，要求： (1)指出寄存器和全加器位数； (2)详细画出第4位(设n为最低位)全加器的输入电路； (3)画出上商的输入电路； (4)描述加减交替操作。
第7题
画出实现n位小数（不包括符号位在内)的补码一位乘运算器框图。要求： （1)指出寄存器和全加器位
画出实现n位小数(不包括符号位在内)的补码一位乘运算器框图。要求： (1)指出寄存器和全加器位数； (2)详细画出最低位全加器的输入电路； (3)描述重复加和移位的操作； (4)指出加和移位次数。
第8题
画出实现补码Booth算法的运算器框图（假设数值取n位)。要求： （1)指出寄存器和全加器的位数；
画出实现补码Booth算法的运算器框图(假设数值取n位)。要求： (1)指出寄存器和全加器的位数； (2)详细画出最低位全加器的输入电路； (3)指出加和移位的次数； (4)描述Booth算法重复加和移位的过程。
第9题
某机器字长为8位，采用双重分组先行进位方案，按2、3、4分组，并设C0为最高位进位，C外为外来进位。
(1)画出进位链框图，并指出小组和大组的输入和输出信号； (2)写出每个进位的逻辑表达式及进位产生时间(门级延迟时间自定)。
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