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[主观题]

用D触发器设计一个可控计数器.当X=0时其计数顺序为4→5→1→3→2→6→4;X=1时其计数顺序为4→6→2→3→1→5+4.组合电路采用与或非门及非门实现.

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更多“用D触发器设计一个可控计数器.当X=0时其计数顺序为4→5→…”相关的问题

第1题

试用JK触发器设计一个模4的可逆计数器。要求控制端X=1，为递增计数；X=0时，为递减计数。状态转换图如

图5．4．12所示。试画出逻辑电路图。

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第2题

试用二进制同步计数器CT74161设计一个可控BCD码计数器.电路有一个控制端K,当K=0时,电路为8421B

CD码计数器;当K=1时,电路为2421BCD码计数器.规定设计电路采用反馈置数法.要求写出设计过程,画出电路图(2421BCD码见表10.7(a),CT74161逻辑符号和功能表见图10.44和表10.7(b)).

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第3题

试用两个JK触发器按步骤设计一个同步时序电路。要求该电路有两个输入E、X。当E=0时，不管X的值等于几，触发器状

态都保持不变；当E=1时，若X=0，则触发器状态按00，01，10，11顺序循环；若X=1，则触发器状态按11，10，01，00顺序循环。

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第4题

试用JK触发器设计一个2位同步二进制多功能计数器。当控制端XY=00时，计数器状态不变；XY=01时，为加

法计数；XY=10时，为减法计数；XY=11时，则次态为现态求反运算。试写出该计数电路的控制输入真值表(包括状态转换激励表)，并画出用与非门和JK触发器实现这一控制的逻辑电路图。

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第5题

用D触发器设计一个模6的二进制同步计数器，其状态图如图5．4．11所示。

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第6题

用JK触发器设计一个同步六进制加1计数器。

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第7题

设计一个6进制的同步计数器，需要（)个触发器。

A.3

B.4

C.5

D.6

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第8题

试用D触发器和门电路设计一个七进制计数器，并检查设计的电路能否自启动。

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第9题

一个4位二进制加法计数器起始状态为1001，当最低位接收到一个脉冲时，触发器状态为（）。

A.0110

B.0100

C.1101

D.1010

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第10题

用拉格朗日中值定理证明当x>0时，ln（1+x）-lnx>1/（1+x）

用拉格朗日中值定理证明当x＞0时，ln（1+x）-lnx＞1/（1+x）

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第11题

当Δx→0时，试将下述命题用导数表示．

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